专利名称：测试数字�？橄低车闹谱鞣椒�
技术领域：
本发明系关于一种数字�？椋渚哂幸蛔圆馐怨δ埽约肮赜诖艘皇帜？橹恢植椒ǎ夜赜谝恢钟靡圆馐允帜？榈姆椒ㄓ胱爸�。
背景技术：
所考虑之数字�？榘泄δ苄宰榧湎狄砸皇实钡姆绞蕉チ允沟酶玫仁帜？槟芄恢葱兴枰δ�。虽然在简单的数字模块中，仍可藉由在外部所观察到之行为来确认数字�？榈墓δ埽坏堑备玫仁帜？楸涞媒衔丛邮保姨乇鹗堑备玫仁帜？榘送焦δ苄宰榧保悴辉倌芄淮油獠坷慈啡戏⑸谀？槟诓康男矶嗖煌谢蛔刺�。因此，为了测试该数字模块，已知之做法是将一个在数字�？槟诓恐δ苄宰榧阜治馐缘ピ⒏霰鹑啡细鞑馐缘ピ蛔詈螅徊馐酝佳凳褂糜诟貌馐缘ピ淙耄幼牛诟貌馐酝佳涑龃λ竦弥貌馐酝佳煊ο当患右约扑恪Ｎ酥葱姓庋姆椒ǎ坝弥龇ㄊ翘峁└貌馐缘ピ桓霾馐酝佳涑龌捍嫫鳎貌馐酝佳梢员患釉赜谄渲校涫涑鱿涤糜诮貌馐酝佳峁┲粮貌馐缘ピ氖淙氪�。为了能够尽可能完全确认一测试单元的功能，尽可能多的输入讯号之不同组合系被应用至该测试单元输入；这样的一个测试单元之输入数量是在数百至数千的范围中。这表示在此一数字讯号情形中，该测试单元输入所使用之不同可能性至少为2100，且有时可能会更多。然而基于时间因素，几乎不可能将这么大数量的测试图样加载至该测试图样输出缓存器、或是计算所分别获得之测试图样响应；因此，普遍的做法是，仅在该测试单元内部中，选择一个可能具有错误最大数量之特定测试图样来加以确认。而其缺点是，这便需要在该测试单元内部结构中考虑一个复杂的选择方法；此外，由于测试图样是经过选择的，通常就不可能确认在一测试单元内部之所有错误。
本发明的目的之一在于提供一具有自测试功能之数字�？橛氪艘皇帜？橹恢圃旆椒ǎ约耙恢质帜？榈牟馐苑椒ā⒂胗靡圆馐砸皇帜？橹爸茫唤宕说靡跃】赡芸焖僦葱懈檬帜？槟诓抗δ苄宰榧蛔酆瞎δ懿馐�。
根据本发明，此一目的系藉由一具有根据权利要求1或25之特征的数字�？�、以及一具有根据权利要求32、33或43之特征的方法、以及一具有根据权利要求40之装置而达成；而权利要求之附属项则分别定义了本发明中较佳且具有优势之具体实施例。
发明内容
本发明系利用一特定输出仅受到测试单元中有限数量输入之变化所影响之发现，这表示由于该测试单元的其它输入并不影响此一特定输出，因此为了观察该测试单元的一输出之行为，仅需将不同的测试图样供至该测试单元之某些输入。为了利用此一事实，根据本发明之一测试图样输出缓存器系被加载，以将一至少部分含有次要模式周期性序列之一测试图样使用至该测试单元之输入；特别是，该次要模式系较该测试图样短了许多。相较于测试图样，由于次要模式的长度较短，因此可使用所有的可能组合来作为一次要模式，而不会过分扩展数字�？榻胁馐灾枰恼迨奔洹�
通常，该测试图样是一个二进制字符，其包含了适用于测试单元输入之逻辑状态的个别位置；举例而言，当使用一长度小于等于30或20位之次要模式时，所得到的不同次要模式之可能数量范围系为220至230，在这样的范围中，仍可能使用每一种可能的组合来作为一次要模式，由于不需要执行选择动作，因而其本质上简化了次要模式及其测试图样的产生；不过，同样可能选择特定之次要模式，藉其而能够直接辨识测试单元中有效大量之错误，且由于同样可以利用此一程序来获得不同测试图样之一减少数量，因此在此情形中亦同样具有优势。
较具优势的是，有效数量系决定于数字�？橹兴悸侵馐缘ピ闹辽倌承┦涑觯徊馐缘ピ囟ㄊ涑鲋行肯滴艘徊馐缘ピ淙胫浚诒痉⒚髦校锰囟ㄊ涑鼋鍪艽艘惶囟ㄊ涑鲋行克跋�。举例而言，若一测试单元之特定输出有效数量为20，则表示为了测试功能性组件而观察特定输出时，由于使用至其它输入并不会在该特定输出发生任何反应，因而仅需合于情理的使用测试图样至该十个输入；由于直接在一数字�？橹杓贫谓胁馐裕虼烁玫雀霰鸩馐缘ピ涑鼍哂械挠行拷峋】赡鼙湫�。
特别是，用于建构该测试图样的长度可以个别测试单元之有效数量为基�。痪倮裕艟哂兄行课�10，其优势在于仅使用本质上长度小于10之次要模式。通常，在一数字模块之测试单元中，将发生不同的有效数量之情形；在此一例子中，次要模式的最大长度可以该最大有效数量或是一平均有效数量之函数来决定。
有利的是，该等次要模式可藉由一反馈移位缓存器而产生，其中在该输出与该移位缓存器的另一移位组件之间的斥或(exclusive-OR)运算结果可提供至该输入。
尚有其它可理解之不同方式可用以计算在测试单元输出处的测试图样响应；该测试图样响应一方面可直接在该测试单元输出处进行计算，因此必须将一个适合用于计算该测试图样响应之装置连接至该测试单元；除此之外，在该测试单元输出处之该测试图样响应亦能够先转换至一测试图样读取缓存器，并接着从后者连续转换至一计算单元。针对该计算，该测试图样响应系可概括损失或是不包括损失；其基本概念在于将测试图样响应的信息内容减少至无论该测试图样是代表具有一连接至测试�？槭淙胫囟ú馐阅？榈牟馐缘ピ饭δ�、或是减少至代表该测试单元的一项错误；由于需要在该测试单元之误差情形与适当功能状态之间作一分辨，因此该测试�？橄煊νǔ；嵫顾跛鹗В辉诖艘磺樾沃校嗫山又词馐酝佳牟馐韵煊ρ顾踉谝黄稹�
测试响应的压缩、或是复数测试响应之压缩不应太大，才能使压缩结果即使是在实际上该测试单元有所缺陷时可以偶然对应至测试单元适当状态之压缩结果。举例而言，若损失压缩之结果为一8位之字符，且该测试单元的适当状态系以一特定之8位数量为特征，则该测试单元之缺陷状态便无法产生一测试响应，由于损失压缩之故，因而未必会产生与无错误情形中所获得之相同的8位值，虽然两者之间是不同的。因此，测试图样响应的压缩、或是复数测试图样响应的压缩，都不应该超过一个特定程度。
一反馈移位缓存器系包含了复数个别缓存器，其中该移位缓存器之输入接收一个在该移位缓存器移位方向上之最后个别移位缓存器输出与至少一个其它之个别移位缓存器输出间之第一异或运算结果；特别是该倒数第二个个别缓存器，最好是适合于一或多个测试图样响应之计算。在此一情形中，至少一个个别缓存器之输入将接收在该第一异或运算结果或前一个个别缓存器之输出与一测试单元输出讯号间之一个第二异或运算之结果，而在第一个别缓存器的情形中之输入将接收在该第一异或运算结果与一测试单元输出讯号间之另一个异或运算之结果。在一特定数量的移位操作之后，将因而获得一个与该等个别缓存器之初始状态以及测试单元的输出讯号有关之签署，其系作为该等个别缓存器之状态，而该测试单元的输出讯号系由于该等异或而被加以考虑。此一签署构成了一个二进制值，其系以该测试单元输出讯号的特定组合或是一测试响应为其特征。以此方式所构成之计算单元同样能够用来计算使用于时间序列(chronological succession)之复数测试响应；因而该等移位缓存器之移位操作可以一周期率而产生，其中新的测试响应系于该周期率应用至该测试单元之输出；这样的程序特别适合应用在将不同的测试图样使用至该测试单元的情形中。
除了使用一测试单元输出的直接输出讯号来执行该第二异或运算之外，亦可以使用一个可平行读取测试响应并连续将其输出以供计算之用的移位缓存器之输出讯号。在这样的移位缓存器之每一移位周期中，供计算之用的该反馈移位缓存器必须执行至少一移位操作，以计算该测试响应的所有位置。
该测试图样最好是被连续读入该测试图样输出缓存器中，在这样的配置中，若一个连接至该测试单元输出的计算单元能够分别计算在一移位缓存器的各移位周期中所获得的测试响应，以作为该测试图样输出缓存器，则不同得次要图样便能够成功移位至该测试图样输出缓存器；不同的次要图样以此一方式而迁移，也就是说，其逐步地通过该测试单元之输入，使得所有次要图样皆成功应用至该测试单元输入的每一区段(section)。由于该测试单元输入之应用会在该测试图样输出缓存器的每一移位周期中变化，因此此一方式有益于在该测试图样输出缓存器之各移位周期中计算该测试单元输出所获得之测试响应。
在一具有优势的例子中，该测试图样输出缓存器可用于将该测试图样应用至该测试单元的输入，亦可用于读入该测试响应，因而该测试图样输出缓存器系具有输入与输出，测试图样输出缓存器之该等输入系连接至该测试单元的输出，而该测试图样输出缓存器的该等输出系连接至该测试单元的输入。为了能够将数据读进该测试图样输出缓存器并将其读出，该测试图样输出缓存器必须设计为一移位缓存器；在运算过程中，首先连续发生移位至测试图样输出缓存器，且该测试图样输出缓存器被接着驱动，以接受所应用至其输入之测试响应，并接着可以连续读出。为了执行这些运算，该测试图样输出缓存器可以具有一串联输入以读入该测试图样、一并联输出以读入另一测试单元的测试响应、以及一串联输出以连续输出该测试响应。
该测试响应因其是从该测试样笨输出缓存器所移位出来的，因而有益于计算；该测试图样输出缓存器之输出可因而被连接至一计算单元的输入，其中该测试单元之一输出系同样直接连接至该计算单元。该计算单元可具有如上述类型之一反馈移位缓存器，该计算单元的反馈移位缓存器系以一个与该测试图样输出缓存器之移位缓存器相同的周期率而驱动；在此一情形中，同样可以使用一个具有反馈移位缓存器的计算单元来计算数据，其中该反馈移位缓存器系具有复数输入，以及可以同时从复数之测试图样输出缓存器将该等测试图样响应递送至该反馈移位缓存器的不同输入；因此在该计算单元中将形成一个签署为复数测试图样之函数，该等测试图样系同时转换至该计算单元。
若使用一测试图样输出缓存器来读入并连续输出一测试响应，通常表示所使用至该测试单元输入之该测试响应将被一测试响应覆写，因而在这样的情形中，有益的是在接受一测试响应之前，该测试图样输出缓存器就会先将一新的测试图样完全加载；而为了避免该测试图样覆写入该测试图样输出缓存器，可使用一个具有两分支的双重移位缓存器，其中一分支系加载该测试图样，而另一分支则用来接收及连续递送该测试响应。
测试单元系互连以形成一测试图样输出缓存器来执行数字�？椴馐裕幸娴氖歉貌馐缘ピ墓δ苄宰榧当皇褂米魑馐酝佳涑龌捍嫫鳎虼四芄皇褂靡丫嬖谥貌馐缘ピ墓δ苄宰榧醋魑馐酝佳涑龌捍嫫鳎欢煌耆鲜实墓δ苄宰榧蚩梢运嬉獾乩┏涠杂χδ苄裕沟糜美刺峁┎馐酝佳涑龌捍嫫鞯谋匾ǚ涯芄唤逵墒褂酶貌馐缘ピ墓δ苄宰榧档停幌嗤墓瓜胍嗍褂糜谝患扑愕ピ淖榧蚴且桓鲇美唇邮沼氪筒馐韵煊χ馐韵煊Χ寥』捍嫫鞯淖榧�。
一测试图样包含了一特定次要图样之周期性序列的至少一部份，或是专门由该特定次要图样之一周期性序列所组成；该次要图样可从一个储存次要图样选择之内存呼叫，也可以有系统地产生，举例而言，可使用一向上或向下计数之数字计数器，而其计数状态即可作为一次要图样。
为了执行数字�？橹δ苄圆馐裕涤诟檬帜？橹惺褂靡桓鲎圆馐缘ピ我佳�(或测试图样)可以在此一自测试单元中独立产生，或是可以使用一工具来从数字�？橥獠靠刂聘米圆馐缘ピ�。在后者之情形中，一次要图样或是用以产生该次要图样之控制讯号都可以转换至该数字�？榈淖圆馐缘ピ蛊洳馐酝佳⒔馐酝佳釉夭馐酝佳涑龌捍嫫髦校煌兀貌馐酝佳煊Σ恍枰欢ㄔ谑帜？槟诓拷屑扑悖倮裕貌馐酝佳煊梢越逵裳顾醯姆绞蕉恢潦帜？橥獠浚⒃谕獠拷屑扑恪�
为了计算该测试单元反应至测试图样，可使用电子束方法；在此情形中，数字�？榈牡缥荒芸梢员环墙哟バ缘丶锹枷吕�。此方法的好处之一在于能够监控未连接至任何测试单元输出之数字模块内部的点。
关于周期性的部分，所使用之该等测试图样可同样具有一可变周期，这可藉由具有不同长度的次要图样而达成；特别是为了达到这样的周期性，可使用反馈移位缓存器。在一个较佳具体实施例中，作为测试图样输出缓存器之移位缓存器的一部份同样可用来作为此一次要图样移位缓存器；然而，由于具有不同长度之次要图样，便需要一个可以用来达到次要图样移位缓存器之可变周期的工具，举例而言，可使用一多任务器，其能够将测试图样输出缓存器之输出反向馈送至次要图样移位缓存器中不同的个别缓存器之输入；该多任务器同样能够连接该次要图样移位缓存器之输入至个别缓存器的不同输出。正如测试图样输出缓存器，该次要图样移位缓存器亦由数字模块的功能性组件所形成，其能够切换为次要图样移位缓存器，以测试该数字�？�。
有益的是，该数字�？榈牟馐韵涤删】赡芏痰拇我佳迹馐且蛭淙菪斫闲∈康牟煌赡苄裕淮我佳某ざ瓤梢越幼胖鸩皆黾又烈桓霾换岬贾寥魏味钔獯砦笳觳饪赡苄灾担姨乇鹗牵黾又烈桓龆杂τ诓馐缘ピ行康氖�。若藉由这样的次要图样长度之逐步增加，可在该次要图样内部使用每一可能组合，则由于具有可整除长度之次要图样必须以较短次要图样之周期序列表示，因此该等次要图样之长度便可根据原始之数字序列而加以选择；然而，以上所述仅使用于由次要图样之一周期性序列所产生之测试图样。
本发明亦关于一个用来产生此一数字�？橹椒�。数字�？橹蟛糠质窃诩扑慊母ㄖ轮葱校渲校荼痉⒚髦瓜耄ü挂桓鍪帜？樗枰糠种葱邢悼纱⒋嬗诩扑慊校沟萌魏涡枰帜？槎寄芄桓荼痉⒚鞫诩扑慊ㄖ讨校逵杉虻ゼ尤胍蛔圆馐怨δ埽渲糜写艘还δ�。
本发明系藉由下列例子之说明并参考伴随的较佳具体实施例之图式而清楚被了解，其中第1图表示根据本发明第一实施例之具有自测试功能的数字�？榻峁梗坏�2图表示根据本发明第二实施例之具有自测试功能的数字�？榻峁梗坏�3图表示根据本发明第三实施例之具有自测试功能的数字�？榻峁梗坏�4图表示根据本发明任一实施例之使用于数字模块中之计算单元的结构；第5图表示根据本发明第四实施例之数字模块的一部份；以及第6图表示根据本发明第五实施例之数字�？榈慕峁�。
具体实施例方式
第1图示意性地代表根据本发明第一实施例之数字�？榈慕峁�。在此第一实施例中，该数字模块包含了一个具有功能性组件之测试单元3、一个测试图样输出缓存器2、以及一个计算单元16，该数字�？橐喟蛔圆馐缘ピ�1，其系用以控制在该数字�？橹蛔圆馐韵辔恢兄圆馐运枰墓δ埽桓貌馐酝佳涑龌捍嫫�2系为一个具有一并联输出与一串联输入之移位缓存器，该测试图样输出缓存器2之并联输出包含了许多输出线，其系分别使用于测试单元2之一输入；该测试图样输出缓存器2之串联输入系连接至自测试单元1，使得后者能够将一个具有数字数值形式、特别是一个二进制数值的测试图样连续加载该测试图样输出缓存器2中。位于右侧的测试单元3之输出系连接于计算单元16的输入，测试图样输出缓存器2及/或计算单元16及/或自测试单元1的组件可为该数字�？榈墓δ苄宰榧湎涤糜谑帜？橹谧圆馐韵辔煌獠康恼Ｔ怂悖⑶谢挥谧圆馐韵辔唬沟盟悄芄恍纬刹馐酝佳涑龌捍嫫�2或计算单元16或自测试单元1；许多的功能性组件系互连于该测试单元3的内部，该测试单元3的输入系对应于测试单元3之功能性组件的可外部寻址性输入，而该测试单元3的输出则对应于测试单元3之功能性组件的可外部观察性输出。在测试单元3内部的功能性组件可为闸极或切换组件，在以测试单元3输入所应用之函数来观察该测试单元3之输出的行为时，可确定该测试单元3的不同输入对于该测试单元3特定输出之影响系形成了有效锥体5，其顶点则分别由测试组件3的特定输出所形成，而其基部则分别包含了该测试单元3输入之一特定有效数量；这表示只有配置于对应之有效锥体5内部的测试单元3输入能够影响此一特定输出，或换言之，只有在该测试单元3之有效数量的输出上之变化能够影响该特定输出；对测试单元3内部的功能性组件之功能测试而言，这表示在观察测试单元3的一个单一输出时，不再需要将交替的讯号提供至该测试单元3的所有输入，而仅需提供至对应于该特定输出的有效数量之输出数量。
为了作一利用，该测试单元3的输入所使用之测试图样系由一个或多个次要图样所形成，特别是，该次要图样长度或该等次要图样之长度并不超过该测试单元3输出的最大或平均之有效数量；然后该测试图样缓存器2的输出系连接至该测试单元3的输出，使得分别属于个别有效锥体5的测试单元3之输入能够参照于该测试图样输出缓存器2之移位方向而尽可能的紧密排列在一起，其中该测试图样输出缓存器2系设计为一移位缓存器。因此，由于该测试图样输出缓存器2的连续加载，该次要图样或该等次要图样之个别位置将彼此相邻排列于该测试图样输出缓存器2输出之移位方向上；因此能够以仅可能短的次要图样来达成该有效锥体5之完全运用。在第1图的实施例中仅表示该测试单元3之输出与输入的一部份，事实上，该测试单元3的输入与输出之数量是在100甚或更大的范围中。该数字�？榭筛哂懈词馐缘ピ�3，其各分配有一测试图样输出缓存器2与一计算单元16，其分别连接至自测试单元1。
交替之测试图样的长度系对应于测试图样3的输入数量，该等测试图样系连续地加载该测试图样输出缓存器2，并于该自测试单元1内部产生，以测试在测试单元3内部的功能性组件。该等测试图样系根据次要图样而产生，其中一测试图样可以部份或是完全地作为一特定次要图样之一周期性序列、或是也可以作为不同的次要图样之一序列；其本质上端视于该计算单元16所能够计算所使用至测试单元3输出的测试响应之周期率。
在该计算单元16能够计算该测试图样输出缓存器2每一移位周期上之测试响应的情形中，为了能够达成对该测试单元3输入使用之修饰、且能够因而在输出处设定一个变化之测试图样响应，将于以下加以考量。在这个情形中，可以连续加载不同的次要图样至该测试图样输出缓存器2，使得不同的测试图样能够连续迁移通过该有效锥体5之输入，该等移位运算系继续执行直到最后一个次要图样已经完全移位经过该测试图样输出缓存器2；当然，在这个情形中，也可以依需要经常地重复一些或是全部的次要图样，举例而言，这样可使得各次要图样能够在同样处理下一个次要图样之前，就连续地二次加载于该测试图样输出缓存器2中。由于该次要图样之进一步重复并不会导致该测试单元3的输入之使用有所不同，因此一个次要图样系权宜地尽可能重复，直到全部的测试图样输出缓存器2都已经充满此一次要图样为止。在此程序之测试图样输出缓存器2的每一移位周期中，可达成该测试单元3之一个修饰使用，且在该计算单元16之输入处可因此而获得一变化之测试响应；因此该计算单元16系于该测试图样输出缓存器2之各移位周期中计算该测试单元3之测试响应。然后所获得之不同的测试响应系由该计算单元16以损失加以压缩，以形成一数字数值之签署，此一签署系从该计算单元16而被转换，特别是连续地转换，至该自测试单元1，使得当一数据函数加载该测试图样输出缓存器2时，后者能够确定在此一情形中所获得之讯号是否指示了该测试单元3内部之功能性组件适当的功能；对于使用于该测试单元3之所选择序列而言，藉由一特定计算单元16与该测试单元3之适当功能所压缩而获得之该签署最好是事先决定并储存于该自测试单元1中；那么后者只需要去比较由该计算单元16与所储存之设定点签署所递送之签署，便能够确定该测试单元3在存在一匹配时是处于一个适当的状态。在该计算单元16内部之此一类型计算中，签署的形成系以周期控制而产生，在该计算单元16内部的签署形成周期系与该测试图样输出缓存器2之移位周期相同。
此外，在该测试图样输出缓存器2之每一移位周期中，计算单元16内部所产生之签署形成亦可具有复数周期；然不利的是，其将减缓数字�？橹δ懿馐�。在某些情形中，该计算单元16亦可设计为能够自我检查所获得之签署、或是所读入之测试响应，其相关于在测试单元3内部之功能性组件是否正确执行功能。
至于在计算单元16本身不能对测试响应执行任何压缩、而仅有一简单的移位缓存器连续转换该测试响应至自测试单元1之情形，将于下述说明中考量。在此一情形中，当该测试响应发生变化，便需要在一个修饰之测试响应产生之前，就首先将该计算单元16的全部内容转换至该自测试单元1中，否则信息将会遗失；这表示在每一次该测试单元3输入之请求产生变化时，所产生之测试响应必须完全转换至该计算单元16并完全读出。在此一情形中，其有助于该测试图样输出缓存器2在每一次完全读出该计算单元16的内容之前，就先完全加载一个新的测试图样，有利的是，每一个新的测试图样皆能够以一特定次要图样之一周期性序列而形成；这表示所存在的次要图样系被连续使用以产生对应的测试图样，一部份、或特别是所有的测试图样都是一特定次要图样的一周期性序列。这些测试图样连续从自测试单元1被加载至测试图样输出缓存器2，该计算单元16系接收了组合之测试响应并在该测试图样输出缓存器2已经加载该测试图样后，就将其转换至该自测试单元1。在这个情形中，测试图样的压缩系发生于该自测试单元1中。
在上述例子中，次要图样可以藉由许多种不同方式产生；一方面中，用来储存所使用之次要图样的一内存系可配置于该自测试单元1内部，该自测试单元1可进而包含一个数字计数器，其计数状态可使用作为次要图样；执行此方法所需要之花费特别少，且特别适合用于短次要图样中，可尝试使用其个别位置的所有组合。
第2图表示了根据本发明第二实施例之一数字�？椋辉诖耍圆馐缘ピ�1来表示；所欲测试之该数字�？榈淖榧到岷嫌谝还δ苄宰榧�11中。举例而言，其具有一个用以使用至在该功能性组件区块11内部之一测试单元3(图中未示)的测试图样输出缓存器2；该功能性组件区块11更包含了一个用来计算测试响应的计算单元(图中未示)。在该测试图样输出缓存器2、该测试单元、与该计算单元之间的交互作用系如第一实施例所说明之方法而发生。
该自测试单元1的结构将于下述说明中讨论；其具有一次要图样移位缓存器15，其中测试图样能够根据所加载的次要图样之重复而产生；因此，该次要图样移位缓存器15在左侧具有一输入，而在右侧具有能够经由多任务器18反馈而加以控制之输出，因此，该次要图样移位缓存器15系连接至该多任务器18，使得该多任务器18能够将该次要图样移位缓存器15之输出反向馈送至在该次要图样移位缓存器15内部之一可选择之移位组件。
为了产生一测试图样，该次要图样移位缓存器15系加载一次要图样，并由该多任务器18设定至一个对应于该次要图样长度之周期；一旦该次要图样移位缓存器15在该移位方向中进一步运算，由于反馈的原因，则依所需经常地重复先前所加载的次要图样。以此方式所获得之该次要图样的周期性序列系经由该次要图样移位缓存器之输出而加载至该测试图样输出缓存器2。一个配置于该自测试单元1内部的内存6可作为次要图样之来源；更可与该内存6之输出一起使用次要图样输入线17，而产生一多任务器7，使得无论是一个来自于该内存6的次要图样、或是经由该次要图样输入线17而来自于外部的所递送之一次要图样，都可以传送至该次要图样移位缓存器15中使用。
原则上，亦可以使用一反馈移位缓存器来取代该内存6而产生次要图样；移位缓存器输入系接收在该输出与该移位缓存器之另一移位组件之间的一个异或运算结果，而该移位缓存器的状态则平行或连续转换至该次要图样移位缓存器15，作为一次要图样。
为了监控测试图样加载测试图样输出缓存器2的过程，可于该自测试单元1内部使用一个计数器10，其可向上计数在该次要图样移位缓存器15之输出处所谓移出的位；该自测试单元1更具有一测试控制区块8，其能够将该功能性组件区块11设定于测试模式。对于测试模式之此一设定而言，举例而言，在该功能性组件区块11内部特定的功能性组件可切换至一测试图样输出缓存器2、或是切换至一计算单元，亦可确认自测试所需要之连接。
该自测试单元1更包含了一测试响应转换区块9，其在所使用之计算单元需要转换控制时，用以控制一测试响应至一计算单元之转换。
接着，该数字�？橹圆馐灾等缦率鏊得�。首先该自测试单元1系利用该测试控制区块8而将该功能性组件区块11设定为测试模式，在藉由该多任务器7选择了所需要之次要图样来源后，一次要图样则经由该次要图样输入线17或是从该内存6而被加载该次要图样输出缓存器15中；所需要之周期则由该多任务器18以所使用之次要图样长度之函数而加以调整。接着，该次要图样移位缓存器15系进一步运算于移位运算中，直到该测试图样输出缓存器2完全被该次要图样之一周期性序列所充满；此一程序系藉由一计数器10的辅助而加以监测。接着，可藉由该测试响应转换区块9而将一个合适的控制指示送至该功能性组件区块11中，其中至少一测试响应系接受至一计算单元。该测试响应之计算藉由一相配配置于该功能性组件区块11内部之计算单元而执行、或是在外部产生；因此，在该功能性组件区块11与该自测试单元1之间需使用一连接(图中未示)，经由该连接可将至少一测试响应转换至该自测试单元1中，以于该处执行计算；更可直接、或是藉由在该数字�？橥獠恐米圆馐缘ピ�1来读出至少一测试响应；而后者则特别适合于次要图样已经藉由次要图样输入线17而从外部递送之情形。
第3图表示本发明之一第三实施例，其中系使用了共有三个测试单元3与三个测试图样输出缓存器2。在此一实施例中，该等测试图样输出缓存器2系配置为移位缓存器，并设计为能够各具有一串联输出、一串联输入、一并联输出、与一并联输入。该等测试图样输出缓存器2之并联输入系分别连接至测试单元3之一输出，使得该测试单元3之测试响应能够被接受至该测试图样输出缓存器2中；如上所述，该等测试图样输出缓存器的并联输出系连接至该测试单元3的输入，以提供一测试图样；同样如上所述，该等串联输入系连接至该自测试单元1，而该等串联输出系连接至一计算单元4。在此一实施例中，各个测试图样输出缓存器2皆使用于一测试单元3输入之一测试图样以及监测该测试响应；然而，由于在该等测试图样输出缓存器2接受测试响应时，先前所包含于该测试图样输出缓存器2中的内容会被覆写，因此本实施例之优势在于能够该等测试图样输出缓存器2能够先将一个新的测试图样完全加载，然后再藉由适当的驱动该等测试图样输出缓存器2来接受组合之测试响应；有利的是，所加载该等测试图样输出缓存器2之该等测试图样是相同的，虽然有时不尽相同。
为了读出已被接受至该等测试图样输出缓存器2之该测试单元3测试响应，该等测试图样输出缓存器2系于移位运算中操作，使得该等测试响应能够被连续转换至该计算单元4；在此例中，该计算单元4系运算而使得在该等测试图样输出缓存器2之移位周期中之测试图样能够被转换至该计算单元4，该测试单元4则共同压缩了最近移位入的位。
第4图代表该计算单元4的一个可能结构。所表示之该计算单元4系由一反馈移位缓存器所形成，该反馈移位缓存器包含了复数之个别移位组件12、或是个别缓存器12；在此例中，移位方向系自左侧向右侧而形成。在此例中，表示于左侧之第一个别缓存器12输入接收了在最后一个个别缓存器12之输出与倒数第二个个别缓存器12之输出间的一个第一异或运算结果；该第一异或运算结果系由一异或门13之辅助而产生，其两输入系分别连接至最后一个与倒数第二个个别缓存器12之输出。亦可使用与连接互连于两个连续的个别缓存器12之间的异或门13，使得该个别缓存器12之输入能够接收在先前之个别缓存器12输出与一讯号间的一个第二异或运算结果；该讯号系经由一输入线19而递送，并对应于所欲计算之讯号。一测试单元的输出可直接连接至输入线19、或是用来接收测试响应与将该测试响应连续传送至计算单元之一测试单元的输出可连接至该等输入线19。在第4图所代表的类型中，举例而言，可根据第三实施例而在该数字模块中使用该计算单元4，在此例中，必须要在计算单元中使用许多输入线19，就像测试图样输出缓存器2一样。此外，亦可根据第一实施例而在数字模块中使用如第4图所表示之计算单元4，在此例中，必须将测试单元3的各个输出连接至该计算单元4地一输出线19。在第4图所表示之计算单元运算期间，需要确认该等个别缓存器12之至少一移位周期是在所使用至该输入线19之讯号变化之后发生；这表示在根据第3图第三实施例之数字�？橹惺褂酶眉扑愕ピ�4时，该等个别缓存器12系由测试图样输出缓存器2之各移位周期中的至少一周期所传送切换；当在一个根据第一实施例之数字�？橹惺褂酶眉扑愕ピ�4时，该计算单元之个别缓存器12同样需要由测试图样输出缓存器2之各移位周期中的至少一周期所传送切换。
由于反馈以及异或运算之故，以使用至该等输入线19之讯号为其特征之一签署系因此而以该等个别缓存器12初始状态与使用至该等输入线19的讯号之一函数而形成；为了读出以此方式形成之签署，如第4图所表示之移位缓存器必须为可切换，使得该等个别缓存器12之内容能够在一特定时间被读出，特别是被连续读出。
第5图表示了根据本发明第四实施例之一数字�？椋黄溆肫渌凳├湓诒局噬系牟钜煸谟谀芄桓焖俚募扑悴馐酝佳�。正如同之前的实施例，测试图样系以次要缓存器2之辅助而使用至测试单元3，在此情形中，四个测试单元3所使用之四个次要缓存器2系串联互连，使得其能够形成一单一的大移位缓存器；四个测试单元3的输入皆使用至四个次要缓存器2，其系设计为能够分别经由一并联的输入来接收测试单元的测试响应，在此例中，该等互连之次要缓存器2共同形成一个单一移位缓存器；下面所表示的次要缓存器2具有平行输入(图中未示)以使用于进一步之测试单元3。进而使用异或门13，并将其与该等次要缓存器12互连，使得各次要缓存器之输出系连接至一异或门13之一第一输入，而其第二输入系连接至一个以其第一输入来接收先前次要缓存器2之输出的异或门13之输出；而在测试图样移位经过该等个别缓存器2时，则有一个同时受到所有四个次要缓存器2作用之位序列出现在以其第一输入来接收移位方向上最后次要缓存器2之异或门13的输出处；因此，只要各短次要缓存器2的测试响应一完全移位出该次要缓存器2，就可以获得一个考虑了所有个别缓存器2之测试响应的签署，这特别适于长测试响应之计算，其中，用于保持一个长测试响应的缓存器系更分为复数缓存器2，在其连接点处则连接有异或门之附加电路。例如在第4图中所描述的一个传统的计算单元4，可连接至最后异或门的输出，并同时用于计算或压缩来自具有额外异或门的个别缓存器2输出之讯号。
第6图表示了根据本发明第五实施例之一数字�？椋黄浠咎卣飨悼煞⑾钟诟霉δ苄宰榧�11，其具有同样用于保持测试响应之复数测试图样输出缓存器2。一反馈移位缓存器14系连接至各测试图样输出缓存器2的左侧，所有的反馈移位缓存器14系藉由多任务器7的辅助而连接在一起，以形成一移位缓存器。各多任务器7系设计为能够将一反馈移位缓存器14的输入连接至反馈移位缓存器14的输出、或是连接至一个先前之反馈移位缓存器14之输出；对第一反馈移位缓存器14而言，该多任务器7可将其输入连接至该反馈移位缓存器14之输出、或是连接至该自测试单元1的一个次要图样输出。藉由此一配置的辅助，可根据在该功能性组件区块11内部之次要图样而产生测试图样，由于多个反馈移位缓存器14的存在，在此一情形中便可根据不同的次要图样而同时产生不同的测试图样；举例而言，这适合于由于不铜得测试单元3而使得测试图样输出缓存器2加载不同测试图样之情形。该自测试单元1包含了一次要图样移位缓存器15与一个用于保持次要图样范围之内存6，该次要图样移位缓存器15将一次要图样连续转换至该东能性组件区块11。
测试图样输出缓存器2的输出系连接至一计算单元4的输入，以产生所有测试图样连续移位出该测试图样输出缓存器2之一签署，其系为了如前述之计算该等测试响应之目的。
为了加载该等测试输出图样输出缓存器2，首先驱动多任务器7，使其将该等反馈移位缓存器14之输入分别连接至先前反馈移位缓存器之输入、或连接至该次要图样移位缓存器15。此一阶段藉由次要图样移位缓存器15的辅助，将一个次要图样从该内存6经由第一多任务器7而加载该第一反馈移位缓存器14；接着，无论是相同的次要图样、或是另一个次要图样，皆可由于所有反馈移位缓存器14最后皆由一次要图样充满之故，而重复反向移位；在此例中，该反馈移位缓存器14可由该次要图样移位出该次要图样移位缓存器15之一函数，而以任何、以及不同的次要图样所充满。当该等反馈移位缓存器14已被所欲之次要图样充满时，则驱动该等多任务器7，使其能够将该等反馈移位缓存器14之输入连接至其输出，使其于反馈运算中操作，且藉此而周期性地重复所加载之次要图样，并将其加载至所对应之测试图样输出缓存器2；在此例中，该自测试单元1可同样包含了多种其它组件(图中未示)，其系为执行该数字模块之自测试所需要，并已结合了其它实施例而描述。
组件符号说明1 自测试单元2 测试图样输出缓存器3 测试单元4 计算单元5 锥体6 内存7 多任务器8 测试控制区块9 测试响应转换区块10 计数器11 功能性组件区块12 个别缓存器13 异或门14 反馈移位缓存器15 次要图样移位缓存器16 计算单元17 次要图样输入线18 多任务器19 输入线
权利要求
1.一种具有功能性组件的数字�？椋渲兄辽僖徊糠莸母霉δ苄宰榧吮恢付ǖ街辽僖痪哂惺淙胗胧涑龅牟馐缘ピ�(3)，至少一测试图样输出缓存器(2)乃将一测试图样应用至该至少一测试单元(3)的输入，以及一自测试单元(1)用于控制该测试图样输出缓存器(2)并将具有数字数值形式的至少一测试图样加载该测试图样输出缓存器(2)，其特征在于该至少一测试图样中至少一部份是一次要图样的周期性序列，其同样具有数字数值形式。
2.如权利要求1数字�？椋涮卣髟谟诟檬帜？榫哂兄辽僖患扑愕ピ�(4)，用以计算应用至该至少一测试单元(3)输出的一测试图样响应。
3.如权利要求2之数字�？椋涮卣髟谟诟檬帜？榫哂兄辽僖徊馐韵煊Χ寥』捍嫫鳎淞又粮貌馐缘ピ�(3)输出，并设计为至少在该数字�？榈囊徊馐阅Ｊ街校芄唤邮沼τ弥粮貌馐缘ピ�(3)输出的一测试响应，并将其连续传送至该计算单元(4)。
4.如权利要求3之数字�？椋涮卣髟谟诟檬帜？榫哂械墓δ苄宰榧捍嫫鳎移浔簧杓莆芄淮痈米圆馐缘ピ�(1)切换至该至少一测试响应读取缓存器(2)。
5.如权利要求3或4之数字�？椋涮卣髟谟诟米圆馐缘ピ�(1)被设计以便完全将一新测试图样加载该测试图样输出缓存器(2)，并接着驱动该等测试响应读取缓存器以接收该测试响应。
6.如权利要求3至5中任一项之数字�？椋涮卣髟谟诟貌馐韵煊Χ寥』捍嫫魇怯梢徊馐酝佳涑龌捍嫫�(2)所形成，其具有与一测试单元(3)的输出相连接的输入。
7.如权利要求3至6中任一项之数字�？椋涮卣髟谟诟貌馐韵煊Χ寥』捍嫫魇且槐幌阜治霰鹨莆换捍嫫�(12)的移位缓存器，且其乃被设计为能够连续传送一在该移位缓存器移位方向上的最后个别移位缓存器(12)的一输出讯号与至少一个其它个别移位缓存器(12)的一输出讯号间异或(exclusive-OR)运算的结果至该计算单元(4)。
8.如权利要求3至6中任一项之数字�？椋涮卣髟谟诟眉扑愕ピ�(4)是一个反馈移位缓存器，其包含了复数个别缓存器(12)且其输入乃接收一在该移位缓存器移位方向上的最后个别移位缓存器(12)输出与至少一其它个别移位缓存器(12)输出间的一第一异或运算结果，至少一个个别缓存器(12)的输入乃接收在该第一异或运算结果或是前一个别缓存器的输出与一测试单元(3)输出讯号间的至少一第二异或运算之结果，而在该移位方向上的该第一个别缓存器(12)中的输入乃接收在该第一异或运算的结果与一测试单元(3)输出讯号间之另一个异或运算的结果。
9.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟弥辽僖徊馐酝佳俗庞筛么我佳闹芷谛孕蛄兴钩�。
10.如权利要求9之数字模块，其特征在于该至少一测试图样乃专门由一次要图样的一周期性序列所构成。
11.如前述各项权利要求中任一项之数字模块，其特征在于该测试图样输出缓存器为一移位缓存器，其被设计，以使至少一测试图样能够从该自测试单元(1)而被连续加载该测试图样输出缓存器(2)。
12.如前述各项权利要求中任一项之数字模块，其特征在于该数字�？樗哂械墓δ苄宰榧捍嫫鳎移浔簧杓莆芄唤逵筛米圆馐缘ピ�(1)而切换至该至少一测试图样输出缓存器(2)。
13.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟米圆馐缘ピ�(1)具有一内存(6)，且其被设计为能够藉由一储存于该内存(6)之次要图样而以一可变周期周期性地形成该测试图样。
14.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟米圆馐缘ピ�(1)具有一计数器，并被设计为能够于上传及/或下载计数方向中操作该计数器，并藉由一作为次要图样的该计数器的计数器状态而形成该测试图样。
15.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟檬帜？榫哂懈词馐酝佳涑龌捍嫫�(2)，并被设计为能将相同的测试图样同时加载该等测试图样输出缓存器(2)。
16.如前述各项权利要求中任一项之数字模块，其特征在于该数字�？榫哂兄辽僖环蠢〈我佳莆换捍嫫�(14)，其能够加载一次要图样，并设计为能够连续输出该测试图样以作为该次要图样之一周期性序列。
17.如权利要求16之数字�？椋涮卣髟谟诟么我佳莆换捍嫫�(14)乃设计为能够具有一可变周期。
18.如权利要求16或17之数字�？椋涮卣髟谟诟么我佳莆换捍嫫�(14)乃被包含于该自测试单元(1)中。
19.如权利要求16或17之数字�？椋涮卣髟谟诟玫炔馐酝佳涑鲆莆换捍嫫鞯囊恍┗捍嫫髂芄槐磺谢恢烈淮我佳莆换捍嫫�(14)。
20.如权利要求16或17之数字模块，其特征在于一测试图样输出缓存器(2)的一部份形成了该次要图样移位缓存器(14)。
21.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟貌馐酝佳淖畲笾芷谀苏攵愿貌馐缘ピ�(3)的一特定输出的测试单元(3)输入而被定为是该测试单元的至少一有效数量之函数，该有效数量为在该测试单元(3)中数量变化会对该测试单元(3)特定输出具影响的输入数量，而且该测试单元(3)特定输出仅受该等输入变化的影响。
22.如前述各项权利要求中任一项之数字模块，其特征在于该测试图样输出缓存器(2)与该测试单元(3)互连，使得该测试单元(3)特定输出仅受该测试单元(3)的输出变化影响，该等输出乃尽可能接近关于该测试图样输出缓存器(2)的输出次序。
23.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟貌馐缘ピ�(3)乃设计，以致于针对该测试单元(3)输出的该测试单元(3)输入的有效数量能够尽可能地�。糜行课诟貌馐缘ピ�(3)中对该测试单元(3)特定输出具影响的输入数量，而该测试单元(3)特定输出仅受该等输入变化的影响。
24.如前述各项权利要求中任一项之数字�？椋涮卣髟谟诟檬帜？榫哂懈米圆馐缘ピ�(1)的输出控制线，而该自测试单元(1)乃设计为能够藉由通过该等控制线而输入的指示辅助来控制。
25.一种具有功能性组件的数字�？椋渲懈霉δ苄宰榧辽僖徊糠莸哪吮恢付ㄖ林辽僖痪哂惺淙胗胧涑龅牟馐缘ピ�(3)，至少一测试图样输出缓存器(2)乃将一测试图样应用至该至少一测试单元(3)之输入，至少一计算单元(4)乃被用以计算应用至该至少一测试单元(3)的输出的一测试图样响应，以及一个自测试单元(1)乃用来控制该至少一测试图样输出缓存器(2)与该计算单元(4)，并用以将具有二进制数值形式的至少一测试图样加载该测试图样输出缓存器，其特征在于该至少一测试图样是来自一次要图样清单的一次要图样的周期性序列，该测试图样输出缓存器(2)为一移位缓存器，该测试图样能够连续加载该测试样本输出缓存器(2)，而该计算单元(4)乃设计为能够在每一周期计算测试图样响应，其中该测试图样的一新部分乃被加载至该测试图样输出缓存器(2)。
26.如权利要求25之数字�？椋涮卣髟谟诟么我佳淖畲蟪ざ仁钦攵愿貌馐缘ピ�(3)的一特定输出的一测试单元(3)输入的至少一有效数量的函数，该有效数量为在该测试单元(3)中数量变化会对该测试单元(3)特定输出具影响的输入数量，而该测试单元(3)特定输出仅受该等输入变化影响。
27.如权利要求25或26之数字�？椋涮卣髟谟诟眉扑愕ピ�(4)是一个反馈移位缓存器，包含了复数个别缓存器(12)且其输入在该移位缓存器移位方向上的最后个别移位缓存器(12)输出与该移位缓存器的至少一其它个别移位缓存器(12)输出间接收一第一异或运算结果。
28.如权利要求25至27中任一项之数字模块，其特征在于该数字�？樗哂械墓δ苄宰榧捍嫫鳎移浔簧杓莆芄唤逵筛米圆馐缘ピ�(1)而切换为该至少一测试图样输出缓存器(2)。
29.如权利要求22至25中任一项之数字模块，其特征在于该自测试单元(1)具有一内存(6)，且其被设计为能够藉由储存于该内存(6)的次要图样来形成该测试图样。
30.如权利要求22至26中任一项之数字�？椋涮卣髟谟诟米圆馐缘ピ�(1)具有一计数器，并被设计为能够于上传及/或下载计数方向中操作该计数器，并藉由该计数器的计数器状态而形成该测试图样。
31.如权利要求22至27中任一项之数字�？椋涮卣髟谟诟檬帜？榫哂懈词馐酝佳涑龌捍嫫�(2)，并被设计为能将相同的测试图样同时加载该等测试图样输出缓存器(2)。
32.一种测试具有功能性组件的一数字�？榈姆椒ǎ渲兄辽僖徊糠莞霉δ苄宰榧吮恢付ㄖ林辽僖桓鼍哂惺淙胗胧涑龅牟馐缘ピ�(3)，至少一测试图样输出缓存器(2)系将一测试图样应用至该至少一测试单元(3)的输入，以及一自测试单元(1)用于控制该测试图样输出缓存器(2)并将具有数字数值形式的一测试图样加载该测试图样输出缓存器(2)，其特征在于该至少一测试图样缓存器(2)乃被加载一测试图样，其中至少一部分测试图样是一次要图样的一周期性序列，其同样具有数字数值的形式，且该至少一测试组件(3)对该测试图样的响应行为乃被加以计算。
33.一种测试具有功能性组件数字�？榈姆椒ǎ渲兄辽僖徊糠莞霉δ苄宰榧吮恢付ㄖ林辽僖痪哂惺淙胗胧涑龅牟馐缘ピ�(3)，至少一测试图样输出缓存器(2)乃将一测试图样应用至该至少一测试单元(3)的输入，该测试图样输出缓存器(2)乃被设计为一移位缓存器，其特征在于该测试图样输出缓存器(2)乃藉一测试图样连续加载，该测试图样具有数字数值形式，而一应用至该至少一测试单元(3)输出的测试图样响应乃于每一周期中计算，其中该测试图样之一位的被加载该测试图样输出缓存器(2)，该测试图样是来自一次要图样清单的一次要图样的周期性序列。
34.如权利要求32或33之方法，其特征在于为了在一具有复数个别缓存器(12)的反馈移位缓存器中计算一测试图样响应，在该移位方向上的最后个别移位缓存器(12)的输出与该移位缓存器的至少一其它个别移位缓存器(12)的输出间的一第一异或(exclusive-OR)运算结果乃被应用至该移位缓存器的输入，至少一个别移位缓存器(12)的输入乃接收在该第一异或运算结果或是前一个别缓存器的输出与一测试单元(3)的一输出讯号间的至少一第二异或运算的结果，而在该移位方向上的第一个别缓存器(12)中的输入乃接收在该第一异或运算结果与一测试单元(3)的一输出讯号间的另一个异或运算结果，以致于一签署乃以该测试单元(3)的至少一输出的函数形式形成于该反馈移位缓存器中。
35.如权利要求32或33之方法，其特征在于一应用至该至少一测试单元(3)输出的测试图样响应乃藉由测试图样读取缓存器的辅助而在一特定时间被接受，并被连续地传送至一计算单元(4)以供计算。
36.如权利要求35之方法，其特征在于该测试图样读取缓存器(2)乃由一测试图样输出缓存器(2)所形成，当该测试图样响应被接受时，该测试图样输出缓存器(2)之内容乃被覆写至一测试图样响应读取缓存器。
37.如权利要求36之方法，其特征在于该数字�？橹鞑馐酝佳涑龌捍嫫�(2)皆能用来将一测试图样应用至该至少一测试单元(3)的输入，并可用来作为一测试图样响应读取缓存器。
38.如权利要求33或34以及35至37其中之一之方法，其特征在于一测试单元(3)的至少一测试图样响应乃藉由该测试图样读取缓存器(2)而连续地被传送至该反馈移位缓存器以作签署形成，该测试图样读取缓存器(2)的连续输出周期率与用以计算的该反馈移位缓存器的连续移位周期率相同。
39.权利要求32或33之方法，其特征在于该至少一测试单元(3)的测试图样响应行为乃由电子束测试方法来计算。
40.一种用以测试具有功能性组件的数字�？榈淖爸茫渲懈霉δ苄宰榧械闹辽僖徊糠菽吮恢付ǖ街辽僖痪哂惺淙胗胧涑龅牟馐缘ピ�(3)，至少一测试图样输出缓存器(2)将一测试图样应用至该至少一测试单元(3)的输入，至少一读取或测试单元乃分别用于读取或计算应用至该至少一测试单元(3)输出的一测试图样响应，以及一自测试单元(1)乃被用于控制该测试图样输出缓存器(2)与该计算或读取单元，并将具有数字数值形式的至少一测试图样加载该测试图样输出缓存器(2)，该装置具有一数据处理工具以产生测试数据，以及一测试图样转换单元，其设计为能够将测试图样转换至该数字�？椋约釉氐礁弥辽僖徊馐酝佳涑龌捍嫫�(2)，其特征在于该测试图样是来自一次要图样清单的一次要图样序列，或是其至少一部份是一次要图样的一周期性序列，该次要图样同样为一数字数值形式，且该装置乃被设计为能够使该数据处理工具产生至少一次要图样以作为测试图样数据，并将其转换至该测试图样转换单元，而该测试图样转换单元从接收自该数据处理单元的至少一次要图样产生该测试图样以加载该数字�？�。
41.如权利要求40之装置，其特征在于该测试图样转换单元是一针板，其具有接触引脚以接触在该数字模块上的接触点。
42.一种用以测试如权利要求1至31中任一项之数字模块的装置，其特征在于该装置乃被设计为能够为了在该数字�？槟诓馐酝佳豢刂浦噶钜圆辽僖淮我佳蚴强刂浦噶睿源铀⒋娴拇我佳醒≡裰辽僖淮我佳�、或是经由数字�？榈氖涑隹刂葡叨辽僖淮我佳恢粮檬帜？槟诘淖圆馐缘ピ�(1)。
43.一种用以产生如权利要求1至31中任一项之数字�？榈姆椒ā�
全文摘要
本案提出一种用于测试具有功能性组件的数字�？榈南低场８玫裙δ苄宰榧环治哂惺淙胗胧涑龅牟馐缘ピ�(3)；测试图样乃被应用至该测试单元(3)的输入，而产生的测试响应乃于该测试单元(3)输出被计算。接着，在一测试单元(3)的各输入的变化并不会完全对一测试组件(3)的一特定输出产生作用；对该测试单元(3)的每一输出而言，可定义一锥体(5)，其顶点乃由该测试单元(3)的特定输出所形成，而其基部则包含该测试单元(3)的输入，其中该特定输出仅受到该等输入变化影响。应用至该测试单元(3)输入的该测试图样的长度乃小于或等于在锥体(5)基部中的测试单元(3)输入的数量。
文档编号G01R31/3185GK1653344SQ03810936
公开日2005年8月10日 申请日期2003年5月14日 优先权日2002年5月15日
发明者R·阿诺尔德, M·海尼茨, S·科佩, V·舍伯 申请人:因芬尼昂技术股份公司
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