专利名称：探针卡及其制作方法以及测试半导体元件的方法
技术领域：
本发明涉及半导体元件的测试方法、用以测试半导体元件的探针卡以及探针卡的制作方法。
背景技术：
在制作集成电路以及半导体芯片时，必须测试电路与半导体芯片，以确保已制成功能元件(functional device) 0这种测试通常是利用一测试探针卡接触半导体芯片的对应区域并进行一或多个功能测试。一般的测试探针卡通常一次可测试一个半导体芯片。传统的探针卡包括一探针 (probe needle)，其可在测试时的任一瞬间电性耦接一半导体芯片。因此，探针通常会限制在任一瞬间的芯片测试数量。在工艺的测试步骤中，一次只能测试一个芯片可能会导致芯片的产能降低，从而可能会延迟或是降低整个产量并增加制作成本。因此，在这个技术领域中亟需可克服前述缺点并可同时测试多个芯片的方法。
发明内容
有鉴于此，本发明提出一种探针卡，包括一接触垫界面，包括多个正面接点与多个背面接点，正面接点与背面接点彼此电性连接，正面接点排列成同时电性连接一晶片上的多个芯片的各自的多个凸块，且背面接点排列成电性连接一测试结构的各自的多个接
点ο本发明提出一种探针卡的制作方法，包括提供一基板，基板具有一第一面与一第二面；形成多个贯穿基板导孔，贯穿基板导孔从第一面延伸至第二面以延伸穿过基板，其中贯穿基板导孔的形成方法包括使用一镜像光刻掩模；在基板的第一面上形成邻接贯穿基板导孔的多个第一导电结构；在基板的第二面上形成多个内连线结构，内连线结构电性连接贯穿基板导孔；以及形成邻接内连线结构的多个第二导电结构。本发明提出一种测试半导体元件的方法，包括提供一探针卡，探针卡包括一接触垫界面，接触垫界面包括多个第一接点；将第一接点同时耦接至一半导体晶片上的多个芯片的多个导电凸块；经由接触垫界面将一第一测试信号传送至半导体晶片；以及接收来自于半导体晶片的一结果信号。本发明中，探针卡接触垫界面可让探针卡接触同一晶片上的多个芯片，并可让探针卡接触同一晶片上的所有芯片。
图1 图16示出本发明一实施例的一探针卡接触垫界面(probe cardcontact pad interface)的制作方法的中间步骤。图17示出本发明另一实施例的具有探针卡接触垫界面的一探针卡的示意图。图18示出本发明又一实施例的利用探针卡测试半导体元件的方法。
其中，附图标记说明如下10 埠板；12 容置环；14 接点；16 探针卡接触垫界面；18 晶片;20 导电凸块；100 基板；102 光致抗蚀剂层；104、106、112 开口；108 蚀刻终止层；110 光致抗蚀剂层；114 氧化层；116 贯穿基板导孔开口；118 导电薄膜；120 导电材料；122 贯穿基板导孔；124 保护层；126 背面金属化层、金属化层；128 过量的导电材料层；130 保护层；1；34 导电柱；136 导电凸块；200、202、204、206 步骤。
具体实施例方式为使本发明的上述目的、特征和优点能更明显易懂，下文特举一优选实施例，并配合附图，作详细说明如下。以下将详述本实施例的制作方法与使用方式。然而，值得注意的是，本文将提供许多可供实施的发明概念，其可在多种不同的情况下实施。在此讨论的特定实施例仅用以介绍以特定的方法制作与使用所公开的主题，而非用以限定不同实施例的范围。实施例包括一探针卡(其可同时测试同一晶片上的多个芯片，例如同一晶片上的所有芯片)以及操作该探针卡的方法。其他的实施例包括探针卡的制作方法，该探针卡可同时测试一晶片上的多个芯片。以下将详述这些实施例中的某些实施例。图1 图16示出本发明一实施例的探针卡接触垫界面的制作方法的中间步骤，该探针卡接触垫界面为探针卡的一部件。图17示出具有图1 图16中的探针卡接触垫界面的探针卡的示意图。在下述的内容中将可了解，探针卡接触垫界面可让探针卡接触同一晶片上的多个芯片，并可让探针卡接触同一晶片上的所有芯片。因此，图18示出测试半导体元件的方法或是操作探针卡的方法。
图1 图3示出一基板的正面工艺(front side processing)的各种步骤。请参照图1，一基板100例如为高电阻硅，一光致抗蚀剂层102形成于基板100的一正面上。光致抗蚀剂层102包括多个暴露出基板100的开口 104。可利用可接受的光刻技术形成开口 104，例如使用一镜像光刻掩模(mirrorlithography mask)曝光光致抗蚀剂层102。镜像光刻掩�？墒游还饪萄谀５木迪癜姹荆痹谑褂锰秸肟ń哟ソ缑娌馐缘木男酒闲纬赏箍橄陆鹗舨�(under bump metal,UBM)接垫时，上述光刻掩�？捎靡酝及富⑿纬晒岽┍；げ慊蚴墙榈绮愕目�。开口 104可位于形成有贯穿基板导孔(throughsubstrate vias, TSVs)的区域中。通过在此步骤中使用镜像光刻掩模，使可形成在基板100的正面上的柱状结构在测试的过程中可对齐并接触形成在晶片的芯片上的导电凸块，这在下文中将详细描述。在图2中，对基板100进行一蚀刻步骤，以移除光致抗蚀剂层102的开口 104所暴露出的部分基板100。因此，光致抗蚀剂层102中的开口 104对应于基板100中的开口 106。前述蚀刻工艺可为各向异性蚀刻(anisotropicetch)工艺。图2还示出(例如以灰化/冲洗工艺，ash/flush process)移除光致抗蚀剂层102后的基板100。请参照图3，对基板100进行一沉积工艺，以于基板100的正面上沉积一蚀刻终止层108。可共形地形成蚀刻终止层108，且其材质可包括氮化硅、氧化硅、氮氧化硅、前述的组合及/或其相似物。可利用任何可接受的技术(例如化学气相沉积工艺)沉积蚀刻终止层108。图4至图6示出基板100的背面工艺。请参照图4，在基板100的背面上形成具有多个开口 112的一光致抗蚀剂层110。开口 112可暴露出部分的基板100。可以可接受的光刻技术(例如利用一光刻掩模曝光光致抗蚀剂层110)形成开口 112，以使得开口 112对齐之前在基板100的正面形成的开口 106。在此步骤中的光刻掩�？晌恢钟美吹玫骄迪窆饪萄谀５脑佳谀＃缟纤觥Ｔ谕�5中，对基板100进行一蚀刻工艺，以移除光致抗蚀剂层110中的开口 112所暴露出的部分基板100，并以例如灰化/冲洗工艺移除光致抗蚀剂层110。蚀刻工艺可为各向异性蚀刻工艺。在图6中，对基板100进行一热氧化步骤，以于基板100的外露的表面上形成一氧化层114，其材质例如为氧化硅及/或其相似物。结合上述的蚀刻步骤可形成贯穿基板100的多个贯穿基板导孔开口 116。在图7中，将一导电薄膜118(例如为铜箔)贴附到基板100的背面。可利用例如模造或冲压工艺贴附导电薄膜118。导电薄膜118的材质亦可为铜合金、钛及/或其相似物。在图8中，在贯穿基板导孔开口 116中沉积一导电材料120，其材质例如为金属，像是铜、 钨、铝、银、前述的组合、及/或其相似物。例如以电镀工艺沉积导电材料120。在图9中， 进行一平坦化工艺(planarization process),例如化学机械研磨(chemical mechanical polish, CMP)，以移除多余的导电材料120，从而形成多个贯穿基板导孔122。图10至图16示出在线上后端工艺(back end of the line processing)的基板 100。在图10中，在基板100的正面上形成一保护层124。保护层IM的材质可为氧化硅、氮化硅、氮氧化硅、高分子材料、前述的组合、或是其相似物，且可利用可接受的沉积技术(例如化学气相沉积工艺)形成保护层124。可例如以化学机械研磨来平坦化保护层124。请参照图11，自基板100的背面移除导电薄膜118。可例如以湿式蚀刻工艺移除导电薄膜118。在图12中，可在基板100的背面上形成一或多个背面金属化层 (back sidemetallization layer) 126。金属化层1 的材质可为硼磷硅玻璃(borophosphosilicate glass, BPSG)、无掺杂的娃酸盐玻璃(un-doped silicateglass)、 氧化硅、氮化硅、前述的组合、及/或其相似物，且可以任何适合的沉积技术(例如化学气相沉积工艺)形成金属化层126。金属化层126中的内连线结构电性连接贯穿基板导孔122。 可以可接受的光刻工艺(例如双镶嵌或是镶嵌工艺)来形成内连线结构。内连线结构的材质可包括金属，例如铜、镍、铝、钨、钛、前述的组合、及/或其相似物。基板100的最外侧金属化层具有一内连线结构的图案，其对齐于一探针卡的一接触板的多个接点，对此在图17 的描述中将有更详尽的讨论。在形成内连线结构时，可能在一或多个金属化层126上形成一过量的导电材料层128，且若是形成有过量的导电材料层128，则可在过量的导电材料层 128上形成一保护层130。保护层130的材质可为氧化硅、氮化硅、氮氧化硅、高分子材料、 前述的组合、或是其相似物，且可以可接受的沉积技术(例如化学气相沉积工艺)形成保护层 130。在图13中，例如以蚀刻保护层IM的方式使保护层IM暴露出贯穿基板导孔122。 蚀刻工艺可例如包括可接受的光刻技术以及各向异性蚀刻工艺。在图14中，在保护层IM 所露出的部分贯穿基板导孔122上形成导电柱134。可在贯穿基板导孔122的外露的部分上电镀导电材料以形成导电柱134，其中该导电材料例如为铜、铜合金、金、前述的组合、及 /或其相似物，并且将该电镀的导电材料浸以一保护的导电材料，例如金及/或其相似物。 通过使用镜像光刻掩模形成贯穿基板导孔122，形成在贯穿基板导孔122上的导电柱134可对齐并接触一晶片的多个芯片上的多个导电凸块，其中可利用用来得到镜像光刻掩模的原始光刻掩模来形成该些导电凸块的图案。请参照图15，例如以化学机械研磨的方式移除所有过量的导电材料层128以及保护层130，以经由一或多个金属化层126的外表面暴露出内连线结构。在图16中，在内连线结构的外露部上形成多个导电凸块136。可通过将外露的内连线结构浸入另一导电材料中 (例如金及/或其相似物)的方式形成导电凸块136。由于基板100的最外侧金属化层具有一内连线结构图案(其对齐一探针卡的一接触板的多个接点)，导电凸块136可对齐该接触板的接点。图17示出本发明一实施例的一探针卡的组件。在图17中，示出一探针卡的一埠板(docking board) 10。可在埠板10上设置一容置环(adoption ring) 12，其可用以将探针卡接触垫界面16夹持或是固定至埠板10。在另一实施例中或是除了本实施例之外，可利用一真空系统来将探针卡接触垫界面16固定至埠板10。探针卡接触垫界面16可以是上述图1至图16所讨论的界面。位于埠板10的接触板上的多个接点14可排列成一均勻的阵列，亦即在一平行于埠板10的底面的一平面中的垂直方向上相邻的接点之间的间距相同。导电凸块136(例如关于图16所讨论的)形成于探针卡接触垫界面16的背面上并对齐接触板上的接点14。因此，导电凸块136亦排列成一均勻的阵列。图17更示出一晶片18，其包括多个芯片，该些芯片上形成有多个导电凸块20。导电凸块20可(或可不)均勻地形成，而且通常凸块不会形成一均勻的阵列。因此，利用镜像光刻掩模(如图1所述)以及以镜像光刻掩模的图案形成贯穿基板导孔122可使形成在探针卡接触垫界面16的正面上的导电柱134对齐晶片18上的导电凸块20。因此，可利用固定在埠板10上的探针卡接触垫界面16同时接触并测试晶片18上的多个或是全部的芯片，进而可提高工艺的产能。探针卡接触垫界面的其他结构可以是使(用于形成贯穿基板导孔的)镜像掩模为一埠板10的接触板上的接点14的镜像版本。如此一来，贯穿基板导孔可对齐接点14，而非对齐晶片上的导电凸块20。可利用一或多个具有内连线结构的金属化层来配置及对齐导电柱与晶片18上的导电凸块20。在其他实施例中，贯穿基板导孔并未对齐接点14或是导电凸块20。更确切地说，金属化层可形成在探针卡接触垫界面的正面与背面以重新分配贯穿基板导孔与接点14或是导电凸块20之间的电连接。本领域技术人员将可轻易了解可修改工艺以形成上述实施例的结构，因此，为简化起见，在此省略讨论这些工艺。请参照图18，其示出本发明另一实施例的测试半导体元件的方法。在步骤200中， 提供一具有接触垫界面(相似于上述关于图17的讨论中的接触垫界面)的探针卡。在步骤202中，接触垫界面的导电柱(例如导电柱134)同时耦接一半导体晶片上的多个芯片的多个导电凸块，例如晶片18的导电凸块20。在一实施例中，接触垫界面的导电柱可同时耦接至一半导体晶片上的所有芯片的导电凸块。然而，在另一实施例中，并非所有的芯片都耦接至接触垫界面。在步骤204中，通过接触垫界面(经由导电柱)传递一测试信号至半导体晶片(经由芯片上的导电凸块)。可传递一或多个测试信号，且可同时传递相同或是不同的测试信号至半导体晶片上的多个或是全部的芯片。在步骤206中，接收来自于半导体晶片的结果信号(result signal)。结果信号可以是一个信号或是多个信号。然后，可以可接受的方法分析结果信号以判定晶片上的芯片的功能是否正确。本发明虽以优选实施例公开如上，然其并非用以限定本发明的范围，任何所属技术领域中的技术人员，在不脱离本发明的精神和范围内，当可做些许的更动与润饰，因此本发明的保护范围当视随附的权利要求所界定的保护为准。
权利要求
1.一种探针卡，包括一接触垫界面，包括多个正面接点与多个背面接点，所述多个正面接点与所述多个背面接点彼此电性连接，所述多个正面接点排列成同时电性连接一晶片上的多个芯片的各自的多个凸块，且所述多个背面接点排列成电性连接一测试结构的各自的多个接点。
2.如权利要求1所述的探针卡，其中所述多个正面接点排列成同时电性连接该晶片上的所有芯片的所述多个各自的凸块。
3.如权利要求1所述的探针卡，其中该测试结构包括一埠板，固定至该接触垫界面，该埠板包括一接触垫，该接触垫包括多个板接点，所述多个板接点为该测试结构的多个接点。
4.如权利要求1所述的探针卡，其中该接触垫界面包括一基板，具有一正面与一背面，该背面相对于该正面，其中所述多个正面接点位于该正面上，所述多个背面接点位于该背面上；多个贯穿基板导孔，贯穿该基板并电性连接所述多个正面接点至对应的所述多个背面接点；以及多个内连线结构，位于该正面与该背面的至少其中之一上，并电性配置于所述多个贯穿基板导孔与所述多个正面接点或是所述多个背面接点之间。
5.一种探针卡的制作方法，包括提供一基板，该基板具有一第一面与一第二面；形成多个贯穿基板导孔，所述多个贯穿基板导孔从该第一面延伸至该第二面以延伸穿过该基板，其中所述多个贯穿基板导孔的形成方法包括使用一镜像光刻掩模；在该基板的该第一面上形成邻接所述多个贯穿基板导孔的多个第一导电结构； 在该基板的该第二面上形成多个内连线结构，所述多个内连线结构电性连接所述多个贯穿基板导孔；以及形成邻接所述多个内连线结构的多个第二导电结构。
6.如权利要求5所述的探针卡的制作方法，还包括将该基板固定至一埠板，其中该第一导电结构或是该第二导电结构直接耦接该埠板的一接触板上的多个接点。
7.如权利要求5所述的探针卡的制作方法，其中所述多个贯穿基板导孔的形成方法包括利用一掩模的一镜像版本作为上述镜像光刻掩模来图案化位于该基板的该第一面上的一光致抗蚀剂层，其中该掩模是用来在被测试的一晶片的多个芯片上的多个凸块下金属层接垫形成多个开口 ；以及蚀刻该基板。
8.如权利要求5所述的探针卡的制作方法，其中所述多个贯穿基板导孔的形成方法包括经由该第一面蚀刻该基板以形成多个第一凹槽； 于所述多个第一凹槽中形成一蚀刻终止层；经由该第二面蚀刻该基板以形成多个第二凹槽，所述多个第二凹槽对齐并连接所述多个第一凹槽，所述多个第一凹槽与所述多个第二凹槽相连而于该基板中形成多个贯穿基板导孔开口 ；以及热氧化所述多个第二凹槽。
9.一种测试半导体元件的方法，包括提供一探针卡，该探针卡包括一接触垫界面，该接触垫界面包括多个第一接点； 将所述多个第一接点同时耦接至一半导体晶片上的多个芯片的多个导电凸块； 经由该接触垫界面将一第一测试信号传送至该半导体晶片；以及接收来自于该半导体晶片的一结果信号。
10.如权利要求9所述的测试半导体元件的方法，其中传送该第一测试信号的方法包括同时传送该第一测试信号至该半导体晶片上的所述多个芯片，以及接收该结果信号的方法包括同时接收来自于该半导体晶片上的所述多个芯片的多个结果信号。
全文摘要
一种探针卡及其制作方法以及测试半导体元件的方法，所述探针卡包括一接触垫界面，包括多个正面接点与多个背面接点，正面接点与背面接点彼此电性连接，正面接点排列成同时电性连接一晶片上的多个芯片的各自的多个凸块，且背面接点排列成电性连接一测试结构的各自的多个接点。本发明中，探针卡接触垫界面可让探针卡接触同一晶片上的多个芯片，并可让探针卡接触同一晶片上的所有芯片。
文档编号G01R31/26GK102288793SQ201010551930
公开日2011年12月21日 申请日期2010年11月16日 优先权日2010年6月17日
发明者周友华, 赖怡仁 申请人:台湾积体电路制造股份有限公司
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